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IDT70T3539M
High-Speed 2.5V 512K x 36 Dual-Port Synchronous Static RAM
Waveform of Interrupt Timing (2)
CLK L
Industrial and Commercial Temperature Ranges
R/ W L
t SW
t SA
t HW
t HA
ADDRESS L (3)
7FFFF
t SC
t HC
CE L
(1)
t INS
INT R
CLK R
CE R (1)
R/ W R
t SC
t SW
t SA
t HC
t HW
t HA
t INR
ADDRESS R (3)
NOTES:
1. CE 0 = V IL and CE 1 = V IH
7FFFF
5678 drw 19
2. All timing is the same for Left and Right ports.
3. Address is for internal register, not the external bus, i.e., address needs to be qualified by one of the Address counter control signals.
Truth Table III — Interrupt Flag (1)
Left Port
Right Port
R/ W R
CLK L
↑
↑
↑
↑
R/ W L
L
X
X
H
(2)
CE L
L
X
X
L
(2)
A 18L -A 0L
7FFFF
X
X
7FFFE
INT L
X
X
L
H
CLK R
↑
↑
↑
↑
X
H
L
X
(2)
CE R (2)
X
L
L
X
A 18R -A 0R
X
7FFFF
7FFFE
X
INT R
L
H
X
X
Function
Set Right INT R Flag
Reset Right INT R Flag
Set Left INT L Flag
Reset Left INT L Flag
NOTES:
1. INT L and INT R must be initialized at power-up by Resetting the flags.
2. CE 0 = V IL and CE 1 = V IH . R/ W and CE are synchronous with respect to the clock and need valid set-up and hold times.
3. Address is for internal register, not the external bus, i.e., address needs to be qualified by one of the Address counter control signals.
18
6.42
5678 tbl 12
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